{"id":9834,"date":"2025-11-04T08:04:13","date_gmt":"2025-11-04T08:04:13","guid":{"rendered":"https:\/\/www.besterpcba.com\/?p=9834"},"modified":"2025-11-04T08:07:59","modified_gmt":"2025-11-04T08:07:59","slug":"boundary-scan-vs-ict-low-runs","status":"publish","type":"post","link":"https:\/\/www.besterpcba.com\/fr\/test-de-delimitation-vs-ict-faibles-executions\/","title":{"rendered":"Couverture des tests qui paie : Vecteur sans scan de fronti\u00e8re plus complet que l'ICT pour les faibles volumes"},"content":{"rendered":"
La pression pour d\u00e9tecter les d\u00e9fauts de fabrication avant l\u2019exp\u00e9dition des cartes est non n\u00e9gociable. Un seul d\u00e9faut \u00e9chapp\u00e9 dans un syst\u00e8me critique peut co\u00fbter exponentiellement plus que le test qui l\u2019aurait d\u00e9tect\u00e9. Cette r\u00e9alit\u00e9 pousse de nombreuses \u00e9quipes d\u2019ing\u00e9nierie vers les tests en circuit (ICT) comme norme, une m\u00e9thode longtemps consid\u00e9r\u00e9e comme la r\u00e9f\u00e9rence en mati\u00e8re de couverture. L\u2019ICT compl\u00e8te offre un acc\u00e8s approfondi \u00e0 presque chaque n\u0153ud d\u2019une carte, promettant des taux de d\u00e9tection de d\u00e9fauts proches du maximum th\u00e9orique. Pour la production \u00e0 volume \u00e9lev\u00e9, l\u2019investissement a du sens ; les co\u00fbts fixes li\u00e9s \u00e0 la conception des fixeurs et \u00e0 l\u2019\u00e9quipement de test sont amortis sur des milliers d\u2019unit\u00e9s, r\u00e9duisant la charge par unit\u00e9 \u00e0 des niveaux n\u00e9gligeables.<\/p>\n\n\n\n
Mais l\u2019\u00e9conomie change lorsque les volumes de production diminuent. Pour des s\u00e9ries inf\u00e9rieures \u00e0 quelques centaines d\u2019unit\u00e9s, les forces m\u00eames de l\u2019ICT deviennent des inconv\u00e9nients. La conception sur mesure du fixateur n\u00e9cessaire pour chaque design de carte implique un co\u00fbt fixe d\u2019ing\u00e9nierie \u00e9lev\u00e9, qui ne s\u2019adapte pas. Les d\u00e9lais s\u2019allongent pendant la conception, la fabrication et le d\u00e9bogage des fixateurs. Les it\u00e9rations de conception, courantes lors de l\u2019introduction de nouveaux produits, invalidant totalement les fixateurs, for\u00e7ant \u00e0 recommencer le cycle. Chez Bester PCBA, nous avons suivi cette logique dans des centaines de projets. Pour des s\u00e9ries inf\u00e9rieures \u00e0 200 ou 300 unit\u00e9s, le co\u00fbt complet de l\u2019ICT ne justifie pas son prix.<\/p>\n\n\n\n
L\u2019alternative n\u2019est pas d\u2019abandonner les tests rigoureux, mais de remplacer le mod\u00e8le bas\u00e9 sur le fixateur par une strat\u00e9gie plus l\u00e9g\u00e8re et plus rapide, reposant sur la balayage par limite, les tests sans vecteur, et les tests fonctionnels cibl\u00e9s. Cette combinaison offre une couverture de d\u00e9faut comparable, \u00e9limine le goulot d\u2019\u00e9tranglement du fixateur, et permet un cycle de d\u00e9bogage plus rapide lorsque des d\u00e9fauts sont d\u00e9tect\u00e9s. Ce changement n\u2019est pas id\u00e9ologique ; c\u2019est une r\u00e9ponse pratique \u00e0 la friction math\u00e9matique et m\u00e9canique que l\u2019ICT impose aux productions \u00e0 faible volume et agiles.<\/p>\n\n\n
L\u2019hypoth\u00e8se ICT et ses limites<\/h2>\n\n\n
Le test en circuit est devenu la norme industrielle \u00e0 une \u00e9poque de conceptions \u00e0 volume \u00e9lev\u00e9 et stables. Le mod\u00e8le \u00e9tait simple : investir massivement \u00e0 l\u2019avance dans un fixateur personnalis\u00e9 et un testeur sophistiqu\u00e9, puis exploiter cet investissement sur des dizaines de milliers d\u2019unit\u00e9s identiques. Avec des temps de test par unit\u00e9 mesur\u00e9s en secondes, le co\u00fbt marginal par carte \u00e9tait effectivement nul apr\u00e8s l\u2019absorption des co\u00fbts fixes. Pour un fabricant d\u2019\u00e9lectronique grand public produisant 50 000 unit\u00e9s du m\u00eame SKU, le calcul \u00e9tait imparable.<\/p>\n\n\n\n
Ce mod\u00e8le de production s\u2019est fractur\u00e9. La fabrication \u00e9lectronique moderne sert de plus en plus des march\u00e9s \u00e0 forte diversit\u00e9 et faible volume. Les cycles de vie des produits sont plus courts, les it\u00e9rations de conception plus fr\u00e9quentes, et la personnalisation un avantage comp\u00e9titif. Une entreprise peut produire 150 unit\u00e9s d\u2019une variante, faire \u00e9voluer la conception, puis produire 200 de la suivante. L\u2019hypoth\u00e8se qu\u2019un seul fixateur testera des milliers de cartes identiques n\u2019est plus valable. Les co\u00fbts fixes, insignifiants en haute volume, deviennent punissants lorsqu\u2019ils sont r\u00e9partis sur quelques centaines d\u2019unit\u00e9s.<\/p>\n\n\n\n
Le mod\u00e8le \u00e9choue lorsque le co\u00fbt total de l\u2019infrastructure ICT d\u00e9passe le co\u00fbt ajust\u00e9 au risque des strat\u00e9gies alternatives. Ce seuil n\u2019est pas arbitraire. Il d\u00e9pend du co\u00fbt du fixateur, du temps d\u2019ing\u00e9nierie, du d\u00e9lai de fabrication, et de la couverture pouvant \u00eatre atteinte par des m\u00e9thodes sans fixateurs. Pour la plupart des designs de cartes, ce seuil se situe entre 200 et 300 unit\u00e9s.<\/p>\n\n\n
Le pi\u00e8ge du co\u00fbt fixe des tests en circuit<\/h2>\n\n
\nUn fixateur ICT personnalis\u00e9 est un artefact con\u00e7u avec un co\u00fbt \u00e9lev\u00e9 et des d\u00e9lais longs, ce qui le rend non rentable pour la production \u00e0 faible volume.<\/figcaption><\/figure>\n<\/div>\n\n\n
Bien que le fixateur soit le co\u00fbt le plus visible de l\u2019ICT, la charge \u00e9conomique r\u00e9elle est bien plus large. Un fixateur ICT personnalis\u00e9 n\u2019est pas un achat standard ; c\u2019est un artefact con\u00e7u sur mesure, sp\u00e9cifiquement pour le layout de la carte. Le processus de conception n\u00e9cessite de traduire la netlist et le placement des composants en une structure m\u00e9canique \u00e9quip\u00e9e de contacts \u00e0 ressort, align\u00e9s avec pr\u00e9cision sur chaque point de test. Le fixateur doit tenir compte des tol\u00e9rances des composants, du d\u00e9laminage de la carte, et de l\u2019usure des probes. Il doit ensuite \u00eatre valid\u00e9 et d\u00e9bogu\u00e9 \u2014 un processus qui r\u00e9v\u00e8le souvent des probl\u00e8mes impr\u00e9vus avec l\u2019acc\u00e8s aux probes ou l\u2019int\u00e9grit\u00e9 du signal.<\/p>\n\n\n
Co\u00fbts d\u2019ing\u00e9nierie des fixateurs et d\u00e9lais<\/h3>\n\n\n
Le co\u00fbt d'ing\u00e9nierie pour une fixation mod\u00e9r\u00e9ment complexe se situe g\u00e9n\u00e9ralement entre $8 000 et $15 000. Les plaques \u00e0 haute densit\u00e9 avec des composants \u00e0 finition fine ou un acc\u00e8s limit\u00e9 aux points de test peuvent faire grimper ce chiffre \u00e0 $25 000 ou plus. Il s'agit purement du co\u00fbt de l'interface m\u00e9canique et \u00e9lectrique personnalis\u00e9e n\u00e9cessaire pour connecter la carte \u00e0 l'\u00e9quipement ICT, s\u00e9par\u00e9 de la d\u00e9pense en capital du testeur lui-m\u00eame.<\/p>\n\n\n\n
Le d\u00e9lai d'ex\u00e9cution est tout aussi important. D\u00e8s que la conception d'une carte est finalis\u00e9e, la conception et la fabrication du fixture prennent g\u00e9n\u00e9ralement entre deux et quatre semaines, s'\u00e9tendant jusqu'\u00e0 six pour les conceptions complexes. Pendant cette p\u00e9riode, la production est suspendue. Les cartes peuvent \u00eatre assembl\u00e9es, mais elles ne peuvent pas \u00eatre test\u00e9es. Elles restent en inventaire, en attente. Si la conception change pendant cette p\u00e9riode \u2014 ce qui est courant lors de l'introduction de nouveaux produits \u2014 le fixture doit \u00eatre modifi\u00e9 ou jet\u00e9. Le compteur se remet \u00e0 z\u00e9ro.<\/p>\n\n\n
La formule du point mort pour les productions \u00e0 faible volume<\/h3>\n\n\n
Le pi\u00e8ge \u00e9conomique devient \u00e9vident lorsque le co\u00fbt du fixture est divis\u00e9 par le nombre d'unit\u00e9s. Un fixture \u00e0 $12 000 pour une production de 100 unit\u00e9s ajoute une charge de $120 \u00e0 chaque carte. Pour une carte avec un devis de $500 en mat\u00e9riaux, cela repr\u00e9sente 24 % de surco\u00fbt pour le test. M\u00eame si le processus ICT est rapide, l'efficacit\u00e9 \u00e9conomique est faible. Le m\u00eame fixture amorti sur 500 unit\u00e9s r\u00e9duit le co\u00fbt par unit\u00e9 \u00e0 $24, une surcharge beaucoup plus acceptable de cinq pour cent. La diff\u00e9rence est purement une question de volume.<\/p>\n\n\n\n
Le point de rentabilit\u00e9 est l'endroit o\u00f9 le co\u00fbt total de l'ICT \u2014 comprenant l'ing\u00e9nierie, la configuration et le co\u00fbt d'opportunit\u00e9 du d\u00e9lai d'ex\u00e9cution \u2014 \u00e9galise le co\u00fbt d'une alternative sans fixture. Pour une strat\u00e9gie combinant la d\u00e9tection par d\u00e9tection de limite, les tests sans vecteurs, et un test fonctionnel l\u00e9ger, le co\u00fbt de l'infrastructure est consid\u00e9rablement inf\u00e9rieur. La d\u00e9tection par d\u00e9tection de limite ne n\u00e9cessite pas de fixture, et les tests sans vecteurs utilisent des capteurs r\u00e9utilisables qui fonctionnent sans contact m\u00e9canique. Tout fixture de test fonctionnel est g\u00e9n\u00e9ralement minimal et g\u00e9n\u00e9rique, et ne n\u00e9cessite pas plusieurs semaines d'ing\u00e9nierie sp\u00e9cifique \u00e0 une carte.<\/p>\n\n\n\n
Pour des volumes de production inf\u00e9rieurs \u00e0 200 unit\u00e9s, l'\u00e9conomie de l'ICT s'effondre. En dessous de 300 unit\u00e9s, le cas est marginal, d\u00e9pendant de la complexit\u00e9 de la carte. Ce n'est qu'au-dessus de 300 unit\u00e9s pour des conceptions stables et non it\u00e9ratives que l'ICT commence \u00e0 redevenir \u00e9conomiquement viable.<\/p>\n\n\n
Ce qu'est r\u00e9ellement le Boundary Scan et le Test sans vecteur<\/h2>\n\n
\nLes tests par d\u00e9tection de limite utilisent une interface num\u00e9rique simple, \u00e9liminant le besoin d'une fixation m\u00e9canique personnalis\u00e9e et permettant une configuration de test rapide.<\/figcaption><\/figure>\n<\/div>\n\n\n
L'alternative aux tests bas\u00e9s sur des fixtures n'est pas un compromis en mati\u00e8re de rigueur, mais un passage \u00e0 des m\u00e9thodes qui exploitent l'infrastructure de conception existante et la mesure sans contact. Ces outils ont \u00e9t\u00e9 d\u00e9velopp\u00e9s pour r\u00e9pondre \u00e0 la m\u00eame tendance qui mine la ICT : augmentation de la densit\u00e9 des circuits et r\u00e9duction de l'acc\u00e8s aux points de test physiques.<\/p>\n\n\n\n
La d\u00e9tection par d\u00e9tection de limite, formalis\u00e9e dans la norme IEEE 1149.1 (connue couramment sous le nom de JTAG), int\u00e8gre la logique de test directement dans les circuits int\u00e9gr\u00e9s d'une carte. Les puces conformes incluent une cha\u00eene de cellules \u00e0 chaque pin d'entr\u00e9e et de sortie. Lors d'un test, une interface \u00e0 quatre fils transf\u00e8re des motifs dans ces cellules, contr\u00f4lant les \u00e9tats logiques sur les r\u00e9seaux de la carte. Les \u00e9tats r\u00e9sultants sont captur\u00e9s et transf\u00e9r\u00e9s pour analyse, permettant au testeur de contr\u00f4ler et d'observer les signaux au niveau des pins sans contact physique. Cette m\u00e9thode non invasive est tr\u00e8s efficace pour d\u00e9tecter les courts-circuits, les ouvertures et les d\u00e9fauts de type stuck-at entre les dispositifs conformes.<\/p>\n\n\n\n
Les tests sans vecteurs compl\u00e8tent cela en utilisant des mesures capacitatives et inductives pour d\u00e9tecter les d\u00e9fauts sur toute la carte. Un r\u00e9seau de capteurs plac\u00e9 \u00e0 proximit\u00e9 de la carte mesure la signature \u00e9lectromagn\u00e9tique des composants et trac\u00e9s assembl\u00e9s. Les courts cr\u00e9ent un couplage capacitif mesurable ; les ouvertures pr\u00e9sentent des changements caract\u00e9ristiques d'imp\u00e9dance. La m\u00e9thode est rapide, sans contact, et peut d\u00e9duire la pr\u00e9sence de composants, leur polarit\u00e9 et leur valeur approximative, ce qui la rend efficace pour d\u00e9tecter les d\u00e9fauts grossiers de fabrication tels que composants manquants, diodes invers\u00e9es, ou traces pont\u00e9es.<\/p>\n\n\n
Comparaison de la couverture : les chiffres derri\u00e8re le compromis<\/h2>\n\n\n
L'objection principale \u00e0 l'abandon de l'ICT est la couverture. Bien que l'ICT puisse, en principe, acc\u00e9der \u00e0 chaque n\u0153ud d'une carte avec suffisamment de points de test, l'affirmation selon laquelle les alternatives sont inf\u00e9rieures est incompl\u00e8te. La v\u00e9ritable question est de savoir si elles atteignent une couverture suffisante pour attraper les d\u00e9fauts qui se produisent r\u00e9ellement, et si un test fonctionnel cibl\u00e9 peut combler l'\u00e9cart restant.<\/p>\n\n\n
Ce que couvre Boundary Scan<\/h3>\n\n\n
La couverture du scan de fronti\u00e8re d\u00e9pend du nombre de composants sur la carte qui sont conformes \u00e0 la norme JTAG. Pour les cartes domin\u00e9es par la logique num\u00e9rique \u2014 microprocesseurs, FPGAs, m\u00e9moire \u2014 la couverture est \u00e9tendue. La cha\u00eene de scan peut tester l'interconnexion entre ces dispositifs avec des taux de d\u00e9tection de d\u00e9fauts d\u00e9passant 95 pour cent pour les courts-circuits, les ouvertures et les d\u00e9fauts<\/p>\n\n\n
Ce que l'analyse sans vecteur apporte<\/h3>\n\n\n
Les tests sans vecteur comblent les lacunes laiss\u00e9es par la d\u00e9tection par scan de bord, en particulier pour les composants passifs et les d\u00e9fauts majeurs d'assemblage. Les mesures capacitives peuvent d\u00e9tecter les r\u00e9sistances manquantes, les valeurs de condensateurs incorrectes et les diodes invers\u00e9es. Moins pr\u00e9cises que les mesures directes de l\u2019ICT, elles constituent n\u00e9anmoins un filtre efficace pour les erreurs les plus courantes : composant erron\u00e9, composant manquant ou mauvais alignement. Cela ajoute de 10 \u00e0 20 pour cent \u00e0 la couverture totale des d\u00e9fauts, offrant une couche de v\u00e9rification sans contact pour les pi\u00e8ces que le scan de bord ne peut pas voir.<\/p>\n\n\n
L'\u00e9cart restant et comment le test fonctionnel l\u00e9ger le comble<\/h3>\n\n\n
La combinaison de la d\u00e9tection par d\u00e9tection de limite et des tests sans vecteurs laisse encore un \u00e9cart dans la validation fonctionnelle et la performance analogique. Un composant peut \u00eatre pr\u00e9sent et connect\u00e9 correctement mais ne pas fonctionner conform\u00e9ment aux sp\u00e9cifications. Une alimentation pourrait fournir une tension mais avec un bruit excessif. C'est l\u00e0 qu'un test fonctionnel l\u00e9ger (FCT) joue son r\u00f4le. Contrairement \u00e0 une configuration ICT compl\u00e8te, un FCT l\u00e9ger valide que la carte remplit sa fonction pr\u00e9vue dans des conditions r\u00e9alistes. Il applique la puissance, stimule les entr\u00e9es, et mesure les sorties. Pour un contr\u00f4leur de moteur, il pourrait v\u00e9rifier la g\u00e9n\u00e9ration de signal PWM ; pour une carte de communication, il pourrait v\u00e9rifier la transmission de donn\u00e9es sans erreur. Le test fonctionnel compl\u00e8te les tests structurels, en d\u00e9tectant les d\u00e9fauts que les autres m\u00e9thodes ne peuvent pas voir.<\/p>\n\n\n\n
Combin\u00e9s, ces trois m\u00e9thodes atteignent g\u00e9n\u00e9ralement une couverture de d\u00e9faillance de 85 \u00e0 95 %. Ce n\u2019est pas 100 %, mais ce n\u2019est pas non plus le cas en pratique pour l'ICT. En raison des limitations des points de test et de l'usure des sondes, la couverture r\u00e9elle de l'ICT est souvent inf\u00e9rieure \u00e0 son maximum th\u00e9orique. La diff\u00e9rence de couverture est bien plus faible que la p\u00e9nalit\u00e9 de co\u00fbt et de d\u00e9lai.<\/p>\n\n\n
L\u2019avantage de la boucle de d\u00e9bogage<\/h2>\n\n\n
La couverture de test n'est que la moiti\u00e9 de l'\u00e9quation de la valeur ; l'autre moiti\u00e9 est la rapidit\u00e9 et la pr\u00e9cision de l'isolation des d\u00e9fauts. Un test qui d\u00e9tecte un d\u00e9faut mais fournit un diagnostic vague augmente le temps et le co\u00fbt n\u00e9cessaires pour en trouver la cause racine.<\/p>\n\n\n\n
Alors que l'ICT est efficace pour signaler les d\u00e9fauts, ses diagnostics peuvent \u00eatre frustrantement vagues. Un testeur peut indiquer que le n\u0153ud 47 est en court-circuit \u00e0 la masse, mais il n'explique pas pourquoi ou o\u00f9. Le technicien doit suivre le sch\u00e9ma, localiser le r\u00e9seau, et inspecter visuellement la zone \u2014 un processus qui peut durer des heures sur une carte dense \u00e0 plusieurs couches.<\/p>\n\n\n\n
Les diagnostics par balayage de limite sont fondamentalement diff\u00e9rents. Parce que la cha\u00eene de balayage est int\u00e9gr\u00e9e dans les composants, le test identifie les d\u00e9fauts \u00e0 des broches et des appareils sp\u00e9cifiques. Un court-circuit entre deux nets est identifi\u00e9 par les broches exactes de l\u2019appareil impliqu\u00e9es, limitant la recherche \u00e0 quelques millim\u00e8tres carr\u00e9s. Les ouvertures sont d\u00e9tect\u00e9es entre des paires sp\u00e9cifiques de conducteurs et de r\u00e9cepteurs. La sortie du diagnostic n\u2019est pas un code de d\u00e9faut. C\u2019est une carte. Cette pr\u00e9cision signifie qu\u2019un d\u00e9faut qui prend une heure \u00e0 d\u00e9boguer avec des donn\u00e9es ICT peut souvent \u00eatre r\u00e9solu en 10 \u00e0 20 minutes avec le balayage de limite. Pour une production de 100 unit\u00e9s avec un taux de d\u00e9faut typique, le temps de d\u00e9bogage cumul\u00e9 \u00e9conomis\u00e9 peut d\u00e9passer 10 heures.<\/p>\n\n\n
D\u00e9lai de livraison et flexibilit\u00e9 : la valeur cach\u00e9e<\/h2>\n\n\n
L\u2019argument \u00e9conomique contre l\u2019ICT pour de faibles volumes est convaincant, mais la p\u00e9nalit\u00e9 de d\u00e9lai de production l\u2019est tout autant. Le processus d\u2019ing\u00e9nierie de la fixation de deux \u00e0 quatre semaines impose un d\u00e9lai obligatoire entre la gel\u00e9e du design et la pr\u00e9paration du test. Pour l\u2019introduction de nouveaux produits, o\u00f9 le d\u00e9lai de mise sur le march\u00e9 est critique, ce d\u00e9lai est souvent inacceptable.<\/p>\n\n\n\n
Le balayage de limite et le test sans vecteur \u00e9liminent cette attente. La configuration du test peut \u00eatre effectu\u00e9e en heures ou en jours, et non en semaines, permettant aux cartes de passer de l\u2019assemblage au test puis \u00e0 l\u2019exp\u00e9dition en flux continu. Cette flexibilit\u00e9 est cruciale lorsque les conceptions \u00e9voluent. Une premi\u00e8re s\u00e9rie de prototypes peut r\u00e9v\u00e9ler des probl\u00e8mes n\u00e9cessitant des changements de conception des circuits. Avec l\u2019ICT, chaque r\u00e9vision exige une nouvelle fixation ou une fixation retravaill\u00e9e, entra\u00eenant \u00e0 nouveau le co\u00fbt et le d\u00e9lai de production. Les sch\u00e9mas de test de balayage de limite, g\u00e9n\u00e9r\u00e9s \u00e0 partir de la netlist, se mettent \u00e0 jour automatiquement avec la conception. Cela cr\u00e9e une strat\u00e9gie de test qui soutient le d\u00e9veloppement it\u00e9ratif plut\u00f4t que de le p\u00e9naliser.<\/p>\n\n\n
Quand choisir encore l'ICT<\/h2>\n\n\n
Mais le cas contre l\u2019ICT \u00e0 faible volume n\u2019est pas absolu. Certaines conceptions et contextes de production justifient encore l\u2019investissement.<\/p>\n\n\n\n
Les cartes avec des sections analogiques ou RF \u00e0 haute densit\u00e9 sont de mauvais candidates pour une strat\u00e9gie purement sans fixation. Les composants analogiques manquent de logique de balayage de limite, et des caract\u00e9ristiques de performance critiques comme le gain ou le bruit de phase ne peuvent pas \u00eatre v\u00e9rifi\u00e9es structurellement. Si la circuiterie analogique ou RF repr\u00e9sente plus de 40 pour cent de la fonctionnalit\u00e9 de la carte, le cas pour l\u2019ICT devient consid\u00e9rablement plus solide.<\/p>\n\n\n\n
Les industries soumises \u00e0 des r\u00e9glementations telles que m\u00e9dical, a\u00e9rospatial et automobile op\u00e8rent souvent selon des r\u00e8gles qui imposent une couverture ou des m\u00e9thodes de test sp\u00e9cifiques. Si une norme de r\u00e9f\u00e9rence exige un test en circuit ou un acc\u00e8s \u00e9quivalent au niveau des n\u0153uds, les strat\u00e9gies alternatives peuvent ne pas suffire. Ici, le co\u00fbt de l\u2019ICT est un co\u00fbt non n\u00e9gociable pour l\u2019entr\u00e9e sur le march\u00e9.<\/p>\n\n\n\n
Enfin, une voie claire et engag\u00e9e vers une production \u00e0 volume \u00e9lev\u00e9 modifie les calculs. Si une premi\u00e8re s\u00e9rie de 150 unit\u00e9s doit atteindre 1 000 unit\u00e9s en six mois, le co\u00fbt de la fixation est amorti sur le volume total pr\u00e9vu. Cela n\u00e9cessite une grande confiance dans la pr\u00e9vision et une conception stable, mais cela peut rendre l\u2019investissement initial rentable.<\/p>\n\n\n
Construire la strat\u00e9gie de test alternative<\/h2>\n\n\n
Remplacer l\u2019ICT n\u2019est pas une simple substitution ; c\u2019est une reconfiguration de l\u2019architecture de test en une strat\u00e9gie stratifi\u00e9e, o\u00f9 chaque couche d\u00e9tecte les d\u00e9fauts que les autres pourraient manquer.<\/p>\n\n\n
\nUne alternative efficace \u00e0 l\u2019ICT utilise une strat\u00e9gie stratifi\u00e9e : d\u2019abord le balayage de limite, puis le test sans vecteur, et enfin un test fonctionnel cibl\u00e9.<\/figcaption><\/figure>\n<\/div>\n\n\n
Le processus doit \u00eatre s\u00e9quentiel. La premi\u00e8re couche est le balayage de limite, qui s\u2019ex\u00e9cute rapidement sur tous les dispositifs conformes pour d\u00e9tecter les d\u00e9fauts d\u2019interconnexion sur les parties num\u00e9riques de la carte. Les cartes qui \u00e9chouent sont signal\u00e9es pour une reprise imm\u00e9diate, \u00e9vitant ainsi des \u00e9checs catastrophiques lors de l\u2019application ult\u00e9rieure de l\u2019alimentation. La seconde couche est le test sans vecteur, qui fonctionne sur toute la carte pour d\u00e9tecter les composants passifs manquants ou incorrects, les courts-circuits importants et les erreurs de polarit\u00e9. Elle couvre les composants et nets invisibles pour la cha\u00eene de balayage.<\/p>\n\n\n\n
La troisi\u00e8me et derni\u00e8re couche est un test fonctionnel cibl\u00e9. Avec les d\u00e9fauts structurels d\u00e9j\u00e0 filtr\u00e9s, la carte est aliment\u00e9e pour valider ses fonctions critiques dans des conditions op\u00e9rationnelles r\u00e9alistes. La port\u00e9e est adapt\u00e9e \u00e0 l\u2019objectif de la carte \u2014 v\u00e9rification de la pr\u00e9cision de l\u2019ADC sur une carte d\u2019acquisition de donn\u00e9es ou r\u00e9gulation de charge sur une alimentation. Cette s\u00e9quence garantit que les d\u00e9fauts catastrophiques sont d\u00e9tect\u00e9s t\u00f4t et de mani\u00e8re non destructive, minimisant le temps de d\u00e9bogage sur les d\u00e9faillances fonctionnelles plus complexes.<\/p>\n\n\n\n
Pour les cartes avec une complexit\u00e9 hybride \u2014 par exemple un noyau num\u00e9rique dense entour\u00e9 d\u2019un conditionnement de signal analogique \u2014 une strat\u00e9gie hybride peut \u00eatre la meilleure. Une fixation ICT partielle peut \u00eatre con\u00e7ue pour sonder uniquement la section analogique critique, laissant la partie num\u00e9rique au balayage de limite. L\u2019\u00e9conomie d\u2019une fixation partielle est plus favorable, r\u00e9duisant le co\u00fbt et le d\u00e9lai tout en fournissant la couverture n\u00e9cessaire pour l\u2019ensemble du design.<\/p>","protected":false},"excerpt":{"rendered":"
Alors que le test de circuit complet (ICT) est la norme pour la production en grande s\u00e9rie, ses co\u00fbts \u00e9lev\u00e9s de fixtures et ses longs d\u00e9lais sont prohibitifs pour les faibles volumes. Pour une production de moins de 300 unit\u00e9s, une strat\u00e9gie plus intelligente combine le scan de fronti\u00e8re, le test sans vecteur et les tests fonctionnels pour obtenir une excellente couverture des d\u00e9fauts sans le fardeau \u00e9conomique et logistique des fixtures personnalis\u00e9s, permettant une fabrication plus rapide et plus flexible.<\/p>","protected":false},"author":1,"featured_media":9833,"comment_status":"open","ping_status":"open","sticky":false,"template":"","format":"standard","meta":{"article_term":"","article_term_alternate":"","article_term_def":"","article_hook":"","auto_links":"","article_topic":"","article_fact_check":"","mt_social_share":"","mt_content_meta":"","mt_glossary_display":"","glossary_heading":"","glossary":"","glossary_alter":"","glossary_def":"","article_task":"Test coverage that pays back: boundary scan plus vectorless over full ICT for low runs","footnotes":""},"categories":[12],"tags":[],"class_list":["post-9834","post","type-post","status-publish","format-standard","has-post-thumbnail","hentry","category-blog"],"_links":{"self":[{"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/posts\/9834","targetHints":{"allow":["GET"]}}],"collection":[{"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/posts"}],"about":[{"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/types\/post"}],"author":[{"embeddable":true,"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/users\/1"}],"replies":[{"embeddable":true,"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/comments?post=9834"}],"version-history":[{"count":1,"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/posts\/9834\/revisions"}],"predecessor-version":[{"id":9839,"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/posts\/9834\/revisions\/9839"}],"wp:featuredmedia":[{"embeddable":true,"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/media\/9833"}],"wp:attachment":[{"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/media?parent=9834"}],"wp:term":[{"taxonomy":"category","embeddable":true,"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/categories?post=9834"},{"taxonomy":"post_tag","embeddable":true,"href":"https:\/\/www.besterpcba.com\/fr\/wp-json\/wp\/v2\/tags?post=9834"}],"curies":[{"name":"wp","href":"https:\/\/api.w.org\/{rel}","templated":true}]}}
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